傑理6905A芯片引腳的設置

傑理6905A芯片只有24引腳,並且大部分都已經設定好了,規定好的引腳用完之後就只剩下最後幾個口。

IR(遙控器口):key_drv_ir.c 中 ir_key_init()找到 IR_PORTC(4) (這裏設置的爲PC4),如果要改的話根據需求修改即可。

AD(硬件按鍵口):key_drv_ad.c 中找到ad_table[] 數組,會看到 AD_KEY_PB9(這個設置即爲PB9)在source insight 中點擊會看到其他口的設置,設置爲對應的即可。

上面介紹了IR 以及AD 的口的設置,接下來介紹單個引腳的設置:
這裏介紹的都是以PC腳爲例:

#define MIO_API_IO_PORT_DIR     JL_PORTC->DIR   //Direct 輸入:|=  輸出:&= ~
#define MIO_API_IO_PORT_DIE     JL_PORTC->DIE   //使能位
#define MIO_API_IO_PORT_OUT    JL_PORTC->OUT  //輸出  高:|=  低:&= ~
#define MIO_API_IO_PORT_PU     JL_PORTC->PU    //上拉 開:|=  關:&= ~
#define MIO_API_IO_PORT_PD     JL_PORTC->PD    //下拉 開:|=  關:&= ~

舉個例子,將PC5設置爲輸出高:

JL_PORTC->DIR &= ~BIT(5); 
JL_PORTC->OUT &= ~BIT(5);
輸入低的話只需要將JL_PORTC->OUT &= ~BIT(5);改爲JL_PORTC->OUT |= BIT(5);即可。

有一些引腳是兩個IO口共用一個引腳,比如PA3和PB13,在進行設置PB13的時候必須將PA3置爲高阻態。只需在mian函數的while(1)前加入: JL_PORTA->PD &=~BIT(3);即可將PA3設置爲高阻態。

還有一種情況就是引腳和DM、DP腳共用,有一次需要添加linein功能,linein需要兩個腳,一個是linein檢測,另外一個是linein數據傳輸。剛好剩下PC3和 PA4腳,而這兩個腳和DM、DP共用。
在dev_linein.h中將改linein檢測修改爲PC3,具體設置如下:

#define AUX_IO_BIT    BIT(3)
#define AUX_DIR_SET   (JL_PORTC->DIR |= AUX_IO_BIT)
#define AUX_PU_SET    (JL_PORTC->PU |= AUX_IO_BIT)
#define AUX_IN_CHECK  (JL_PORTC->IN & AUX_IO_BIT)

在linein.c 中,將aux_dac_channel_on()中修改linein數據引腳爲PA4,具體設置如下:

JL_PORTA->DIR |= (BIT(4));
JL_PORTA->DIE &= ~(BIT(4));
JL_PORTA->PU  &= ~(BIT(4));
JL_PORTA->PD  &= ~(BIT(4));
//這裏將PA4設置爲高阻態,普通IO口設置IO口的方法也如此。

介紹一下將USB的DM、DP設置爲高阻態的方法:
在sys_detect.c中,將usb_2_io() 修改爲如下:

USB_DM_PU(0);
USB_DM_PD(0);
USB_DM_DIR(1);
//這裏將DM腳設置爲高阻態。

還不清楚的小夥伴可以添加我的個人微信 lqy—1997 (中間是三個英文的槓)進行交流。

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