原创 verilog編寫的自動售貨機，使用狀態機實現。
基於verilog的自動售貨機，平臺爲：quartues，仿真：altera-modelsim。 項目要求利用FPGA實現自動售貨機的核心控制部分。說明如下： 1.核心控制部分的時鐘輸入爲50MHz。 2.外部復位輸入爲低電平有效
2020-06-28 06:15:25
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原创 ISE調試過程中經常遇到的幾種warning，以及解決辦法
由於最近已經也剛剛接手項目，遇到特別多的問題，所以把遇到的問題記錄一下，自己學習的同時，把過程分享出來，希望對大家有一定的幫助，共同進步。下面就是ISE調試過程中經常遇到的幾種warning，以及解決辦法，自己整理成文檔，以供參考
2020-06-28 06:15:25
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原创 如何安裝WinDriver—linux 系統下和Windows系統下———官網中文教程
Windows安裝說明 系統要求 任何x86 32位或64位（x64：AMD64或Intel EM64T）處理器。 任何支持C或.NET的編譯器或開發環境 Windows XP至少需要SP2。 安裝注意 1、在Windows上安裝
2020-06-28 06:15:25
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原创 uart異步串行收發器 設計報告
目錄 一、設計需求 二、頂層設計 三、頂層架構 四、發送器線性序列機（線性鏈狀態機）設計 五、接收器線性序列機設計 一、設計需求 1.一個具有接收發送流緩存的異步串行收發器 2.流緩存深度256，數據寬度8 3.異步串行收
2020-06-28 06:15:25
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原创 精簡指令集程序內置CPU設計（8位和16位）
作者：大馬猴 一、精簡指令集程序內置CPU設計 1.1 設計需求 1.2 指令集設計 1.2.1 指令結構 1.2.2 指令碼錶 1.3 頂層設計 1.4 頂層架構（FSMD） 1.5 數據通道部分架構（Datapa
2020-06-28 06:15:25
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原创 基於verilog的數字萬年曆時鐘設計
一 digital_clock設計需求 本設計採用FPGA，實現核心控制。利用獨立按鍵當作輸入，利用六位一體的共陽極數碼管作爲顯示設備。具體要求如下： 1.數字鐘要求顯示時間、日期、鬧鐘時間。本設計採用verilog，芯片爲50M
2020-06-28 06:15:25
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原创 使用verilog編寫週期爲4s的呼吸燈，基於quartues平臺，並具有測試文件查看波形，適合新手入門
使用verilog編寫週期爲4s的呼吸燈，基於quartues平臺，並具有測試文件查看波形，適合新手入門 編寫文件如下： module breath_led(clk,rst_n,led); input wire clk
2020-06-28 06:15:25
原创 linux系統下questasim 10.7安裝破解步驟
網上關於這個資料比較少，自己親自操作一遍以後，發現會遇到很多的問題，特此記錄一下，方便各位同學操作，也方便自己以後閱讀。如果你覺得對你有幫助，請先關注評論再給個贊吧~ 關於安裝：直接運行install 就行了，但是切記看好你的版本
2020-06-28 06:15:25
原创 幾乎所有的版本、期限最長功能最多的Vivado的license文件
INCREMENT VIVADO_HLS xilinxd 2037.05 permanent uncounted AF3E86892AA2 VENDOR_STRING=License_Type:Bought HOSTID=ANY
2020-06-28 06:15:24
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原创 不使用加減號，使用verilog實現多位加法器功能
如何在不使用加減號的情況下，用verilog實現多位加法器的功能呢？ 其實這一道FPGA面試的的題目，原理很簡單，希望能對即將畢業想從事FPGA的小夥伴能起到一定的幫助（大馬猴表示想和很多小夥伴交流共同成長）。 拿到這道題
2020-06-28 06:15:24
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原创 xilinx 的FFT IP核的使用手冊及仿真結果，matlab仿真結果對比，適合初學者學習
1、FFT的IP核的信號分析 clk：時鐘信號，上升沿有效 start：FFT的啓動信號，高電平有效。當此信號變高時，開始輸入數據，隨後直接進行FFT轉換操作和數據輸出。一個STATRT脈衝，允許對一幀進行FFT轉換。如果每N個時
2020-06-28 06:15:24
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原创 串行RapidIO技術簡要介紹
1、基本概念 1.1產生背景及什麼是RapidIO技術？ 嵌入式系統簡潔，高效，專用的特點得到了計算機，通信和信息產業的廣泛認可。目前，嵌入式系統已成爲通信和消費類產品的共同發展方向。RapidIO針對高性能嵌入式系統芯片間和板間
2020-06-28 06:15:24
原创 FPGA研發心得~~轉
FPGA是個什麼玩意？ 首先來說： FPGA是一種器件。其英文名 feild programable gate arry 。很長，但不通俗。通俗來說，是一種功能強大似乎無所不能的器件。通常用於通信、網絡、圖像處理、工業控制等不同
2020-06-28 06:15:24
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原创 基於fpga的dds設計報告
dds設計報告 大馬猴 2019-3-31 版本目錄： 版本 ：V1.0 作者： 大馬猴 說明 ：初版 備註 一．dds設計需求 首先使用matalab生成可供ROM初始化的mif文件，能夠提供方波、鋸齒波、三
2020-06-28 06:15:24
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原创 雙時鐘FIFO設計例子
2.2.1 頂層設計 2.2.2 頂層架構 2.2.4 安全FIFO訪問 1.最小滿用量MinUsedwFull=3 2.最小空用量MinUsedwEmpty=3 2.2.5 讀握手的算法流程圖ASM Charts 2.2
2020-03-30 23:04:57