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原创 Quartus 工程中移除signaltap的方法

Quartus 工程中移除signaltap的方法 問題描述:觀察完信號之後,不想以後的quartus工程繼續每次全編譯都編譯signaltap,加快編譯時間 辦法:在quartus的project navigator中右擊step1.

原创 Error: The core supply voltage value of '1.0V' is illegal for the currently

https://zhidao.baidu.com/question/585637062375409445.html 在編譯quartus,提示“1.0V” 電壓不正確 新建quartus工程,並編譯後,出現如下錯誤”Error:The c

原创 Illegal output or inout port connection for port 'load'.

今天在用modelsim仿真的時候遇到這個報錯,後來發現原因是在verilog的源代碼中,把輸入的io口load的類型本來應該是input結果自動補全寫成了inout,所以引起報錯。 處理方法,要麼verilog代碼把inout改回inp

原创 AD altium designer 邊框keep-out layer有幾個圓弧相切不能做outline

就是把outline上的線先換到別的層(比如說絲印層)連上,然後再換回到outline層上,就好了 答案找到於:http://www.edatop.com/ee/pcb/300886.html

原创 modelsim_crack筆記

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原创 modelsim時序仿真查看中間信號,多位(128bits)如何一次性添加(# invalid command name "0")

問題描述: 只能從仿真左邊的框框裏一個一個的拖出來,一共有128位。如何把這多個bits同時引出來? modelsim做時序仿真,頂層文件 tdc_carry_chain.v 下面有一個module 叫 unsigned_adder.

原创 LogicLock: 邏輯鎖定流程與實踐:(時序約束、邏輯鎖定、反標、增量編譯)

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原创 將整個網站頁面變成黑白色

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原创 畢導教你如何答辯

https://www.bilibili.com/video/BV1XT4y1u7ca    如何答辯

原创 51單片機C語言us級延時函數

轉載自:https://blog.csdn.net/shawsun/article/details/24560255 Shawsun 2014-04-26 23:34:21      C程序中可使用不同類型的變量來進行延時設計。經實驗測試

原创 C# 如何讓TextBox的滾動條自動處於最下部_百度知道

C# 如何讓TextBox的滾動條自動處於最下部_百度知道  https://zhidao.baidu.com/question/121281757.html 【滾動條自動處於TextBox最下部可以用兩行代碼實現】 注意:這兩種

原创 ubuntu安裝搜狗輸入法後無法進入桌面環境問題

搜狗輸入法for linux 在ubuntu1604 下載後直接打開deb安裝, 毀我一下午!!!!!!!!!!!!!!!!!!!!!!!!!!! baidu 經驗終於找到修復的方法,恢復了 ubuntu安裝搜狗輸入法後無法進入桌面環境問

原创 ubuntu 卡在waiting for unattended-upgr to exit的解決

https://blog.csdn.net/notacoder/article/details/102680465 需要刪除以下幾個lock file就OK了 sudo rm /var/lib/apt/lists/lock sudo