ModelSim仿真時注意事項，先添加信號，再仿真Run All，否則No Data

在仿真電路時，Run 一定time後，添加要觀察的信號後，無論如何都沒波形數據，出現No Data，原來是順序問題（我的是這麼回事）：

or1200仿真TB文件：

`timescale 1ns/100ps

module or1200_tb();

reg CLOCK_50;
reg rst;

initial begin
	CLOCK_50 = 1'b0;//時鐘20ns一個週期，所以時鐘頻率是50MHZ
	forever #10 CLOCK_50 = ~CLOCK_50;
end

initial begin
	rst = 1'b1;//復位信號
	#200 rst = 1'b0;//在200ns處復位結束
	#1000 $stop;//仿真過程持續1000ns
end


or1200_top or1200_top_inst //openrisc最小系統，除了時鐘、復位信號外，其餘全部設置位0
(
	// System
	.clk_i(CLOCK_50), .rst_i(rst), .pic_ints_i(20'b0), .clmode_i(2'b00),

	// Instruction WISHBONE INTERFACE
	.iwb_clk_i(CLOCK_50), .iwb_rst_i(rst), .iwb_ack_i(1'b0), .iwb_err_i(1'b0), .iwb_rty_i(1'b0), .iwb_dat_i(32'b0),
	.iwb_cyc_o(), .iwb_adr_o(), .iwb_stb_o(), .iwb_we_o(), .iwb_sel_o(), .iwb_dat_o(),
`ifdef OR1200_WB_CAB
	.iwb_cab_o(),
`endif
`ifdef OR1200_WB_B3
	.iwb_cti_o(), .iwb_bte_o(),
`endif
	// Data WISHBONE INTERFACE
	.dwb_clk_i(CLOCK_50), .dwb_rst_i(rst), .dwb_ack_i(1'b0), .dwb_err_i(1'b0), .dwb_rty_i(1'b0), .dwb_dat_i(32'b0),
	.dwb_cyc_o(), .dwb_adr_o(), .dwb_stb_o(), .dwb_we_o(), .dwb_sel_o(), .dwb_dat_o(),
`ifdef OR1200_WB_CAB
	.dwb_cab_o(),
`endif
`ifdef OR1200_WB_B3
	.dwb_cti_o(), .dwb_bte_o(),
`endif

	// External Debug Interface
	.dbg_stall_i(1'b0), .dbg_ewt_i(1'b0), .dbg_lss_o(), .dbg_is_o(), .dbg_wp_o(), .dbg_bp_o(),
	.dbg_stb_i(1'b0), .dbg_we_i(1'b0), .dbg_adr_i(0), .dbg_dat_i(0), .dbg_dat_o(), .dbg_ack_o(),
	
`ifdef OR1200_BIST
	// RAM BIST
	.mbist_si_i(1'b0), .mbist_so_o(), .mbist_ctrl_i(0),
`endif
	// Power Management
	.pm_cpustall_i(1'b0),
	.pm_clksd_o(), .pm_dc_gate_o(), .pm_ic_gate_o(), .pm_dmmu_gate_o(), 
	.pm_immu_gate_o(), .pm_tt_gate_o(), .pm_cpu_gate_o(), .pm_wakeup_o(), .pm_lvolt_o(),
	.sig_tick()
);

endmodule

指令內存數據：

指令共有6條

仿真結果：

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