10G Ethernet PCS/PMA IP 核

原創

2020-05-16 18:15

目录

一个完整的10G以太网接口分为10G PHY和10G MAC两部分。上一节对MAC进行过介绍，这里主要讲PHY。通常都会用PHY芯片，目前vivado也有PHY 对应的IP 核10G Ethernet PCS/PMA。

1 代码说明

可以查看一下RTL级原理图，详细看一下送入核的时钟核覆位。

2 时序说明

發表評論

所有評論

還沒有人評論，想成為第一個評論的人麼? 請在上方評論欄輸入並且點擊發布.

相關文章

基于ZYNQ的千兆网项目(1)

基於ZYNQ的TCP Client實現參考文獻項目描述TCP協議簡述TCP 三次握手TCP 數據傳輸TCP 四次揮手PL端設計PS端設計下板測試總結參考文獻 [1]、inner_peace8 [2]、米聯客項目描述前面的文章

2020-07-07 00:27:42

国产EDA工具Robei与Quartus ii联合使用（及在Rrobei设计中一些小技巧）

背景：集成電路設計軟件目前在世界上只有幾家公司在做，普遍分佈在歐美等國家，中國的集成電路設計軟件長期依賴於盜版和進口。“工欲善其事，必先利其器”，中國要想大力發展集成電路產業，首先要有自主知識產權的集成電路設計工具。Robei

千歌叹尽执夏

2020-07-06 23:12:39

15年后重新使用FPGA

上次使用FPGA是2004年了，如今項目需要，重新使用FPGA，看了一個例程，蒙了！只認識modul，begin，其他一概不知了，原來使用的是VHDL語言，現在的都是Verilog語言，沒有辦法開始啃書吧！ paremeter 定

2020-07-06 13:05:55

FPGA的异步复位与同步复位

FPGA的異步復位與同步復位博主微信：flm13724054952，不懂的有疑惑的也可以加微信諮詢，歡迎大家前來投稿，謝謝！引言在做FPGA或者數字IC電路設計的時候，無法避免的一個問題就是電路的復位設計，電路的復位方式一般

2020-07-08 03:50:33

FPGA学习笔记---二进制码、独热码、格雷码分析对比

在Verilog學習中常用的編碼方式有二進制編碼(Binary)、格雷碼(Gray-code)編碼、獨熱碼(One-hot)編碼，對於新手來說，搞不清楚編碼爲什麼要分這麼多格式？統一用一種格式不好嗎？那麼現在就來看看這三種編

2020-07-07 11:27:29

一键清理Quartus工程编译垃圾

在學習FPGA時，會使用到Quartus軟件，這個軟件生成的文件非常多，常常一個很簡單的功能，生成的工程文件夾就有幾十兆，在工程複製和存儲時非常佔用空間，那麼能不能在調試完工程之後，把沒用的中間文件刪掉，只留下關鍵文件就

2020-07-07 11:27:28

U-boot和Linux下对内存的读写

在U-boot下可以通過md和mw命令操作DDR內存，具體用法如下： mw命令格式：

2020-07-07 08:41:13

关于FPGA时序约束的学习笔记-时序模型的分析

最近一直在學習FPGA時序約束的內容，看了很多的教程。所以想用這篇去整理一下思路。好讓自己能夠堅持下去。學習時序分析都離不開一個節點對節點的模型，如下圖；這個模型是FPGA時序分析的基礎模型，描述數據在兩個寄存器間傳輸的一般

福利屯屯草

2020-07-07 07:39:04

ZYNQ 之PS 和PL 互联技术之AXI

1. ZYNQ 概述 2. AXI 概述 AXI (Advanced eXtensible Interface)是xilinx 從6系列fpga開始引入的一個接口協議，主要描述了主設備和從設備之間的數據傳輸方式。主設備和從設備之間通過

2020-07-07 01:27:27

基于ZYNQ的千兆网项目(3)

基於ZYNQ的UDP實現項目簡述UDP簡述PL端設計PS端設計下板測試總結項目簡述前面的文章講解了TCP客戶機與主機在ZYNQ上面的實現，其實說白了就是調用現成的API函數，這點與FPGA的設計其安全不同，因爲進行FPGA設計

2020-07-07 00:27:42

基于ZYNQ的千兆网项目(2)

基於ZYNQ的TCP Server實現項目描述PL端設計PS端設計下板測試總結項目描述上一篇文章我們講解了ZYNQ做Client來進行與PC機進行通信，那麼相應的ZYNQ就可以做Server來進行與PC機得通信，此時PC機就是

2020-07-07 00:27:42

Verilog的基本语法

模塊是設計的基本單元，在Verilog中包括行爲建模（用於綜合和仿真）和結構建模（用於綜合）在Verilog中，begin和end充當了C語言中大括號的角色，在這兩個關鍵詞之間是程序的內容部分；模

2020-07-06 20:27:16

一个价值百万的BUG

背景介紹最近幫人友情解決了某個PCBA廠家ATE設備的BUG，這個BUG導致DUT硬件板卡ADC數據轉換結果不穩定甚至不準確。這個頑疾已經存在9個年頭，爲此這條產線多配置了一個測試員，專門負責這個BUG的調試工作，每當DUT的A

知之不如行之

2020-07-06 20:06:42

system verilog

SystemVerilog語言簡介 SystemVerilog是一種硬件描述和驗證語言（HDVL），它基於IEEE 1364-2001 Verilog硬件描述語言（HDL），並對其進行了擴展，包括擴充了C語言數據類型、結構、壓縮和

2020-07-06 05:28:18

【转载】IEEE 802协议总览

IEEE 802又稱爲LMSC（LAN /MAN Standards Committee，局域網/城域網標準委員會），致力於研究局域網和城域網的物理層和MAC層中定義的服務和協議，對應OSI網絡參考模型的最低兩層（即物理層和數據鏈路層）

2020-07-07 02:09:08

24小時熱門文章

最新文章

最新評論文章